UV 光刻机迈向 Hyper NA:ASML 发布下一代超高数值孔径路线图,锚定 2030 年代超先进制程
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06-18
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当地时间 6 月 17 日,SPIE EUVL 2026 国际极紫外光刻大会上,全球 EUV 设备龙头 ASML 正式披露Hyper NA EUV完整技术研发蓝图,继 0.55 NA High-NA 实现产业化落地后,联合光学合作伙伴蔡司启动 NA≥0.75 超高数值孔径 EUV 光刻机全链路研发,补齐 2033 年 A7 节点之后先进芯片制造的光刻方案,为 AI 算力、高性能计算、量子芯片等下一代高集成度器件打通工艺底层支撑。

一、三代 EUV NA 迭代:从 0.33 到 0.75,分辨率实现阶梯式跨越

数值孔径(NA)是决定光刻分辨率的核心光学指标,NA 数值越高,单次曝光可打印的电路尺寸越精细,大幅规避多重曝光带来的高成本、低良率痛点。

  1. 初代量产 EUV(NA 0.33):当前成熟主力机型,单次曝光极限分辨率 13nm,支撑 7nm~3nm 主流制程,多层金属布线需 2-3 次多重曝光,工艺流程冗长;
  2. High-NA EUV(NA 0.55):当前产业化核心机型,代表设备 TWINSCAN EXE:5000,单次曝光 8nm 分辨率,适配 2nm、1.4nm(A14)节点,英特尔已完成批量设备部署,台积电、三星同步采购研发样机,单台设备成本超 3.5 亿欧元,订单已排至 2030 年;
  3. Hyper NA EUV(NA 0.75):本次官宣下一代核心方案,NA 相较 High-NA 提升 36%,理论分辨率再提升 30%-40%,目标实现5nm 单次曝光图形化,最小工艺间距下无需多重曝光,直接承接 A7(0.7nm 代次)及之后超先进逻辑、存储芯片制造需求。

ASML 技术高级副总裁 Jos Benschop 现场解读,半导体微缩路线持续推进,High-NA 设备将在 2033 年前后抵达单次曝光物理极限,唯有 Hyper NA 技术能够延续摩尔定律微缩节奏,设备架构基于成熟 EXE 平台迭代,无需完全重构整机框架,降低产业化改造成本与周期。

二、Hyper NA 核心技术突破与严苛工程挑战

Hyper NA EUV 核心升级围绕超高精度光学系统、全偏振光源、纳米级稳定平台三大维度,由 ASML 与蔡司联合攻坚光学物镜系统:

  1. 超大口径超高精度反射镜组:物镜镜面曲率误差控制在 0.1nm 以内,整套光学系统容纳超百片特种钼硅多层膜反射镜,单块镜面加工、检测周期超 18 个月;相较 High-NA,整机光学收集角度大幅拓宽,同步解决大 NA 带来的像差畸变问题;
  2. 全域偏振可控曝光光源:搭载全新可分区调控偏振照明模块,针对 10nm 及以下极小间距电路图形优化成像对比度,抑制随机光刻缺陷,为下一代超薄光刻胶材料配套适配能力;
  3. 亚纳米级整机动态稳定性:晶圆台、光学模组综合振动控制指标提升 3 倍,曝光过程晶圆图像稳定度控制在 0.35nm 以内,保障高密度晶体管阵列均匀成型。

行业同时指出,Hyper NA 落地仍存在多重工程壁垒:更大数值孔径会缩短光刻焦深,对光刻胶厚度、晶圆表面平整度提出极致要求;EUV 光源能量利用率随 NA 提升有所下降,需同步升级高功率 13.5nm 等离子光源;设备研发、制造、洁净厂房配套投入将再创历史新高。

三、产业价值:适配 AI 算力与下一代芯片赛道

当前全球大模型 AI 芯片、HBM 高带宽存储、量子计算芯片对晶体管密度需求持续爆发,传统多重曝光工艺会带来晶圆成本暴涨、良率损耗、生产周期拉长等痛点。Hyper NA EUV 量产落地后将实现多重产业价值:

  1. 简化制造流程,降本增效:10nm 及以下金属布线仅需单次曝光,替代原 3-4 重曝光、数十道配套刻蚀沉积工序,单位晶圆综合制造成本下降、良率显著提升;
  2. 支撑超高密度算力芯片:可制造晶体管密度远超当前 2nm 工艺的逻辑芯片,适配万亿参数大模型、车载高阶自动驾驶算力平台;
  3. 打通先进存储迭代通道:适配下一代高密度 DRAM、3D 堆叠存储微缩需求,缓解 HBM 内存带宽提升的工艺瓶颈;
  4. 拓展新型器件制造边界:为二维材料晶体管、硅基量子芯片、存算一体芯片提供高精度图形化工艺基础。

四、产业落地时间线与厂商布局节奏

ASML 明确 Hyper NA EUV 分三阶段推进:

  1. 2026-2030 年 研发验证期:蔡司完成初代超高 NA 物镜原型开发,imec、英特尔、台积电同步搭建 Hyper NA 微型曝光实验平台,开展材料、光刻胶、掩模配套研发;
  2. 2030 年代初 首台原型机下线:完成整机集成、工厂验证,向头部晶圆厂交付测试机型;
  3. 2030 年代中后期 小规模量产导入:匹配 2033 年 A7 节点工艺研发节奏,2035 年前后实现商业化批量交付。

晶圆厂端,英特尔已同步启动 Hyper NA 工艺预研;台积电、三星表示将持续跟进 ASML 技术路线,同步预留研发预算,待设备成熟后规划采购布局。业内机构分析,Hyper NA EUV 将进一步抬高先进制程制造门槛,全球头部三家逻辑晶圆厂将长期主导 3nm 以下超先进工艺产能。

从 NA 0.33 到 Hyper NA 0.75,EUV 光刻技术跨越三代光学革新,持续守住摩尔定律的工艺底层根基。在全球 AI 算力需求持续扩张、新型半导体器件加速迭代的背景下,Hyper NA EUV 路线图的正式发布,为未来十年超先进芯片制造划定清晰技术路径,光学、光刻胶、掩模、精密机械等整条半导体产业链也将同步开启新一轮技术升级周期。

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